[Linux-ivv4] Fwd: Einladung zum Intel HPC CODE MODERNISIERUNGS-WORKSHOP am LRZ in Garching - Mi 6. Mai / Do 7. Mai 2015
Adam, Dr. Heinz-Hermann
adamh at uni-muenster.de
Fr Apr 10 09:25:32 CEST 2015
Anfang der weitergeleiteten E‑Mail:
Von: "Babnik, Nina" <nina.babnik at intel.com<mailto:nina.babnik at intel.com>>
Datum: 10. April 2015 09:20:07 MESZ
An: "Babnik, Nina" <nina.babnik at intel.com<mailto:nina.babnik at intel.com>>
Betreff: Einladung zum Intel HPC CODE MODERNISIERUNGS-WORKSHOP am LRZ in Garching - Mi 6. Mai / Do 7. Mai 2015
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Als Nutzer der Intel Software Produkte laden wir Sie herzlich ein,
am Mi 6. Mai und Do 7. Mai 2015 am LRZ in Garching bei MĂĽnchen, zum
HPC CODE MODERNISIERUNGS-WORKSHOP
für Intel® Xeon® & Xeon Phi™
Die Teilnahme ist kostenlos. Die Plätze sind allerdings begrenzt.
Bitte registrieren Sie sich unter:
http://www.inteldevconference.com/events/munich-germany
· Ein Muss für HPC-Experten, Software-Entwickler, Projektleiter und Forscher, die im Umfeld von Paralleler Programmierung das Neueste über HPC Software Trends, effiziente Programmiermethoden und werkzeuge von Insidern von Intel erfahren möchten.
· Am ersten Tag, lernen Sie wie HPC-Applikationscode für die aktuellen und für die zukünftigen Intel-Architekturen und- Plattformen modernisiert und Performance optimiert werden kann, vor allem für C/C++ und Fortran Code. Ab 16:00 Uhr haben Sie die Möglichkeit in kleinen Gruppen das Rechenzentrum des LRZ zu besichtigen (Teilnehmeranzahl begrenzt, nach Eingang der Registrierung).
· Am zweiten Tag, zeigen wir Ihnen Tutorials anhand konkreter Beispiele aus der Praxis.
· Die Vorträge und Tutorials werden großteils in englischer Sprache gehalten.
· Sie können sich für beide Tage oder nur für einen der beiden Tage registrieren.
· Zum Abendessen und Networking am ersten Tag laden wir Sie auch herzlich ein.
Die detaillierte Agenda finden Sie weiter unten.
Datum: Mittwoch 6. Mai 2015 ab 8:00 Uhr (Beginn des Worshops 9:00 Uhr)
und Donnerstag 7. Mai 2015 ab 8:00 Uhr (Beginn des Worshops 9:00 Uhr)
Ort: LRZ - Leibniz-Rechenzentrum der Bayerischen Akademie der Wissenschaften
BoltzmannstraĂźe 1, 85748 Garching bei MĂĽnchen
Wegbeschreibung: https://www.lrz.de/wir/kontakt/weg/
Registrierung unter: http://www.inteldevconference.com/events/munich-germany<http://www.inteldevconference.com/events/munich-germany/>
AGENDA Tag 1 (6. Mai 2015)
08:00
09:00
FrĂĽhstĂĽck
09:00
9:45
Intel Xeon & Xeon Phi Architectures and Roadmap (incl. Future Xeon products, KNL)
Learn about technical advances and features of the latest and future Intel processors, especially Xeon and Xeon Phi. The presentation is specifically targeted at HPC software developers.
9:45
10:30
Overview of Intel Software Technologies for Developers – What’s new?
This session will cover the newest features built into the Intel Compilers, the MKL library as well as the analysis tools available in the current releases of Intel Parallel Studio XE Professional and Cluster Edition 2015.
10:30
10:45
Kaffeepause
10:45
12:00
"Standards, Standards and Standards”
Code modernization starts with evaluating and implementing standards. This session will show which standards are best suited to scale forward with the hardware technologies of the future: C++11, Fortran 2003, 2008, OpenMP 4.x, MPI3.0
12:00
13:00
Mittagessen
13:00
14:00
Best Practices for Vectorization - Getting ready for Intel Advanced Vector Extensions 512
Vectorization is one of the critical elements to maximize parallel performance. This session will show how to get started and prepare for vectorization and avoid common pitfalls.
14:00
15:00
Intel® Vector Advisor – Overview with demo
Vector Advisor 2016 aims at modernizing software for x86 CPU/co-processor by simplifying efficient vectorization and memory usage through unique new capabilities like: Memory access pattern profiling, Loop-carried dependencies analysis, Deep source and assembly integration, Automated code change recommendations and Trip Count data for loops. The beta testing will start shortly after this conference.
15:00
15:15
Kaffeepause
15:15
16:45
Scaling MPI- Hybrid Applications Towards Performance
MPI applications that scale well are a critical aspect of HPC. This session will address topics around pinning MPI- and hybrid applications as well as identifying bottlenecks. A further aspect will be the tuning of the MPI library itself, where users can gain performance w/o touching their source- code at all.
Besuch SuperMUC
Von 16 bis 18 Uhr haben Sie die Möglichkeit in kleinen Gruppen das Rechenzentrum vom LRZ mit dem Superrechner SuperMUC
zu besichtigen.
Die Besucherzahl ist begrenzt. Es gilt „First There First Served“ nach Anmeldung am Tag des Workshops.
16:45
17:15
Maximizing Performance & Scalability Using Performance Libraries
Why would you spend time on optimizing functions in your source code when others already done the work for you? Intel’s performance libraries like MKL can help to further increase code performance.
17:15
18:00
Fragen & Antworten
Ab
18:00
Networking-Abend / Cocktailempfang
Diskutieren Sie mit Experten von Intel, Bayncore und ho-Computer in geselliger Runde.
Ort: Garching
AGENDA Tag 2 (7. Mai 2015)
08:00
09:00
FrĂĽhstĂĽck
09:00
10:30
TUTORIAL 1
Real-world examples for Vectorization
10:30
10:45
Kaffeepause
10:45
12:15
Tutorial 2
Getting in-depth Vectorization with Intel® Vector Advisor
12:15
13:15
Mittagessen
13:15
14:45
Tutorial 3
Case studies for efficient performance tuning
14:45
15:00
Kaffeepause
15:00
17:00
Tutorial 4
Debugging HPC Code with Allinea
17:00
17:30
Fragen & Antworten
In Zusammenarbeit mit:
[http://www.parallelcon.de/images/hoLogoIntelElite2014-300.png]
HO-Computer GmbH<http://hocomputer.de/>
[cid:image003.jpg at 01D072E1.7E1AAD70]
Bayncore Limited<http://www.bayncore.com/>
________________________________
For more information regarding performance and optimization choices in Intel® software products, visit
http://software.intel.com/en-us/articles/optimization-notice<http://software.intel.com/en-us/articles/optimization-notice#opt-en>.
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